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synced 2024-12-28 20:37:27 +00:00
drm/radeon/kms/evergreen: add initial CS parser
Advanced validation is not implemented yet. The mesa code that uses this will be released soon. Signed-off-by: Alex Deucher <alexdeucher@gmail.com> Signed-off-by: Dave Airlie <airlied@redhat.com>
This commit is contained in:
Alex Deucher
Dave Airlie
parent
36d1701c50
commit
cb5fcbd540
@ -33,6 +33,9 @@ $(obj)/rs600_reg_safe.h: $(src)/reg_srcs/rs600 $(obj)/mkregtable
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$(obj)/r600_reg_safe.h: $(src)/reg_srcs/r600 $(obj)/mkregtable
|
$(obj)/r600_reg_safe.h: $(src)/reg_srcs/r600 $(obj)/mkregtable
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||||||
$(call if_changed,mkregtable)
|
$(call if_changed,mkregtable)
|
||||||
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||||||
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$(obj)/evergreen_reg_safe.h: $(src)/reg_srcs/evergreen $(obj)/mkregtable
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||||||
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$(call if_changed,mkregtable)
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||||||
$(obj)/r100.o: $(obj)/r100_reg_safe.h $(obj)/rn50_reg_safe.h
|
$(obj)/r100.o: $(obj)/r100_reg_safe.h $(obj)/rn50_reg_safe.h
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||||||
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||||||
$(obj)/r200.o: $(obj)/r200_reg_safe.h
|
$(obj)/r200.o: $(obj)/r200_reg_safe.h
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||||||
@ -47,6 +50,8 @@ $(obj)/rs600.o: $(obj)/rs600_reg_safe.h
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|||||||
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$(obj)/r600_cs.o: $(obj)/r600_reg_safe.h
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$(obj)/r600_cs.o: $(obj)/r600_reg_safe.h
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||||||
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||||||
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$(obj)/evergreen_cs.o: $(obj)/evergreen_reg_safe.h
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radeon-y := radeon_drv.o radeon_cp.o radeon_state.o radeon_mem.o \
|
radeon-y := radeon_drv.o radeon_cp.o radeon_state.o radeon_mem.o \
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||||||
radeon_irq.o r300_cmdbuf.o r600_cp.o
|
radeon_irq.o r300_cmdbuf.o r600_cp.o
|
||||||
# add KMS driver
|
# add KMS driver
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@ -60,7 +65,7 @@ radeon-y += radeon_device.o radeon_asic.o radeon_kms.o \
|
|||||||
rs400.o rs600.o rs690.o rv515.o r520.o r600.o rv770.o radeon_test.o \
|
rs400.o rs600.o rs690.o rv515.o r520.o r600.o rv770.o radeon_test.o \
|
||||||
r200.o radeon_legacy_tv.o r600_cs.o r600_blit.o r600_blit_shaders.o \
|
r200.o radeon_legacy_tv.o r600_cs.o r600_blit.o r600_blit_shaders.o \
|
||||||
r600_blit_kms.o radeon_pm.o atombios_dp.o r600_audio.o r600_hdmi.o \
|
r600_blit_kms.o radeon_pm.o atombios_dp.o r600_audio.o r600_hdmi.o \
|
||||||
evergreen.o
|
evergreen.o evergreen_cs.o
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||||||
radeon-$(CONFIG_COMPAT) += radeon_ioc32.o
|
radeon-$(CONFIG_COMPAT) += radeon_ioc32.o
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radeon-$(CONFIG_VGA_SWITCHEROO) += radeon_atpx_handler.o
|
radeon-$(CONFIG_VGA_SWITCHEROO) += radeon_atpx_handler.o
|
||||||
|
|||||||
1356
drivers/gpu/drm/radeon/evergreen_cs.c
Normal file
1356
drivers/gpu/drm/radeon/evergreen_cs.c
Normal file
File diff suppressed because it is too large
Load Diff
@ -151,6 +151,9 @@
|
|||||||
#define EVERGREEN_DATA_FORMAT 0x6b00
|
#define EVERGREEN_DATA_FORMAT 0x6b00
|
||||||
# define EVERGREEN_INTERLEAVE_EN (1 << 0)
|
# define EVERGREEN_INTERLEAVE_EN (1 << 0)
|
||||||
#define EVERGREEN_DESKTOP_HEIGHT 0x6b04
|
#define EVERGREEN_DESKTOP_HEIGHT 0x6b04
|
||||||
|
#define EVERGREEN_VLINE_START_END 0x6b08
|
||||||
|
#define EVERGREEN_VLINE_STATUS 0x6bb8
|
||||||
|
# define EVERGREEN_VLINE_STAT (1 << 12)
|
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|
|
||||||
#define EVERGREEN_VIEWPORT_START 0x6d70
|
#define EVERGREEN_VIEWPORT_START 0x6d70
|
||||||
#define EVERGREEN_VIEWPORT_SIZE 0x6d74
|
#define EVERGREEN_VIEWPORT_SIZE 0x6d74
|
||||||
|
|||||||
@ -218,6 +218,8 @@
|
|||||||
#define CLIP_VTX_REORDER_ENA (1 << 0)
|
#define CLIP_VTX_REORDER_ENA (1 << 0)
|
||||||
#define NUM_CLIP_SEQ(x) ((x) << 1)
|
#define NUM_CLIP_SEQ(x) ((x) << 1)
|
||||||
#define PA_SC_AA_CONFIG 0x28C04
|
#define PA_SC_AA_CONFIG 0x28C04
|
||||||
|
#define MSAA_NUM_SAMPLES_SHIFT 0
|
||||||
|
#define MSAA_NUM_SAMPLES_MASK 0x3
|
||||||
#define PA_SC_CLIPRECT_RULE 0x2820C
|
#define PA_SC_CLIPRECT_RULE 0x2820C
|
||||||
#define PA_SC_EDGERULE 0x28230
|
#define PA_SC_EDGERULE 0x28230
|
||||||
#define PA_SC_FIFO_SIZE 0x8BCC
|
#define PA_SC_FIFO_SIZE 0x8BCC
|
||||||
@ -553,4 +555,466 @@
|
|||||||
# define DC_HPDx_RX_INT_TIMER(x) ((x) << 16)
|
# define DC_HPDx_RX_INT_TIMER(x) ((x) << 16)
|
||||||
# define DC_HPDx_EN (1 << 28)
|
# define DC_HPDx_EN (1 << 28)
|
||||||
|
|
||||||
|
/*
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||||||
|
* PM4
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|
*/
|
||||||
|
#define PACKET_TYPE0 0
|
||||||
|
#define PACKET_TYPE1 1
|
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|
#define PACKET_TYPE2 2
|
||||||
|
#define PACKET_TYPE3 3
|
||||||
|
|
||||||
|
#define CP_PACKET_GET_TYPE(h) (((h) >> 30) & 3)
|
||||||
|
#define CP_PACKET_GET_COUNT(h) (((h) >> 16) & 0x3FFF)
|
||||||
|
#define CP_PACKET0_GET_REG(h) (((h) & 0xFFFF) << 2)
|
||||||
|
#define CP_PACKET3_GET_OPCODE(h) (((h) >> 8) & 0xFF)
|
||||||
|
#define PACKET0(reg, n) ((PACKET_TYPE0 << 30) | \
|
||||||
|
(((reg) >> 2) & 0xFFFF) | \
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||||||
|
((n) & 0x3FFF) << 16)
|
||||||
|
#define CP_PACKET2 0x80000000
|
||||||
|
#define PACKET2_PAD_SHIFT 0
|
||||||
|
#define PACKET2_PAD_MASK (0x3fffffff << 0)
|
||||||
|
|
||||||
|
#define PACKET2(v) (CP_PACKET2 | REG_SET(PACKET2_PAD, (v)))
|
||||||
|
|
||||||
|
#define PACKET3(op, n) ((PACKET_TYPE3 << 30) | \
|
||||||
|
(((op) & 0xFF) << 8) | \
|
||||||
|
((n) & 0x3FFF) << 16)
|
||||||
|
|
||||||
|
/* Packet 3 types */
|
||||||
|
#define PACKET3_NOP 0x10
|
||||||
|
#define PACKET3_SET_BASE 0x11
|
||||||
|
#define PACKET3_CLEAR_STATE 0x12
|
||||||
|
#define PACKET3_INDIRECT_BUFFER_SIZE 0x13
|
||||||
|
#define PACKET3_DISPATCH_DIRECT 0x15
|
||||||
|
#define PACKET3_DISPATCH_INDIRECT 0x16
|
||||||
|
#define PACKET3_INDIRECT_BUFFER_END 0x17
|
||||||
|
#define PACKET3_SET_PREDICATION 0x20
|
||||||
|
#define PACKET3_REG_RMW 0x21
|
||||||
|
#define PACKET3_COND_EXEC 0x22
|
||||||
|
#define PACKET3_PRED_EXEC 0x23
|
||||||
|
#define PACKET3_DRAW_INDIRECT 0x24
|
||||||
|
#define PACKET3_DRAW_INDEX_INDIRECT 0x25
|
||||||
|
#define PACKET3_INDEX_BASE 0x26
|
||||||
|
#define PACKET3_DRAW_INDEX_2 0x27
|
||||||
|
#define PACKET3_CONTEXT_CONTROL 0x28
|
||||||
|
#define PACKET3_DRAW_INDEX_OFFSET 0x29
|
||||||
|
#define PACKET3_INDEX_TYPE 0x2A
|
||||||
|
#define PACKET3_DRAW_INDEX 0x2B
|
||||||
|
#define PACKET3_DRAW_INDEX_AUTO 0x2D
|
||||||
|
#define PACKET3_DRAW_INDEX_IMMD 0x2E
|
||||||
|
#define PACKET3_NUM_INSTANCES 0x2F
|
||||||
|
#define PACKET3_DRAW_INDEX_MULTI_AUTO 0x30
|
||||||
|
#define PACKET3_STRMOUT_BUFFER_UPDATE 0x34
|
||||||
|
#define PACKET3_DRAW_INDEX_OFFSET_2 0x35
|
||||||
|
#define PACKET3_DRAW_INDEX_MULTI_ELEMENT 0x36
|
||||||
|
#define PACKET3_MEM_SEMAPHORE 0x39
|
||||||
|
#define PACKET3_MPEG_INDEX 0x3A
|
||||||
|
#define PACKET3_WAIT_REG_MEM 0x3C
|
||||||
|
#define PACKET3_MEM_WRITE 0x3D
|
||||||
|
#define PACKET3_INDIRECT_BUFFER 0x32
|
||||||
|
#define PACKET3_SURFACE_SYNC 0x43
|
||||||
|
# define PACKET3_CB0_DEST_BASE_ENA (1 << 6)
|
||||||
|
# define PACKET3_CB1_DEST_BASE_ENA (1 << 7)
|
||||||
|
# define PACKET3_CB2_DEST_BASE_ENA (1 << 8)
|
||||||
|
# define PACKET3_CB3_DEST_BASE_ENA (1 << 9)
|
||||||
|
# define PACKET3_CB4_DEST_BASE_ENA (1 << 10)
|
||||||
|
# define PACKET3_CB5_DEST_BASE_ENA (1 << 11)
|
||||||
|
# define PACKET3_CB6_DEST_BASE_ENA (1 << 12)
|
||||||
|
# define PACKET3_CB7_DEST_BASE_ENA (1 << 13)
|
||||||
|
# define PACKET3_DB_DEST_BASE_ENA (1 << 14)
|
||||||
|
# define PACKET3_CB8_DEST_BASE_ENA (1 << 15)
|
||||||
|
# define PACKET3_CB9_DEST_BASE_ENA (1 << 16)
|
||||||
|
# define PACKET3_CB10_DEST_BASE_ENA (1 << 17)
|
||||||
|
# define PACKET3_CB11_DEST_BASE_ENA (1 << 17)
|
||||||
|
# define PACKET3_FULL_CACHE_ENA (1 << 20)
|
||||||
|
# define PACKET3_TC_ACTION_ENA (1 << 23)
|
||||||
|
# define PACKET3_VC_ACTION_ENA (1 << 24)
|
||||||
|
# define PACKET3_CB_ACTION_ENA (1 << 25)
|
||||||
|
# define PACKET3_DB_ACTION_ENA (1 << 26)
|
||||||
|
# define PACKET3_SH_ACTION_ENA (1 << 27)
|
||||||
|
# define PACKET3_SMX_ACTION_ENA (1 << 28)
|
||||||
|
#define PACKET3_ME_INITIALIZE 0x44
|
||||||
|
#define PACKET3_ME_INITIALIZE_DEVICE_ID(x) ((x) << 16)
|
||||||
|
#define PACKET3_COND_WRITE 0x45
|
||||||
|
#define PACKET3_EVENT_WRITE 0x46
|
||||||
|
#define PACKET3_EVENT_WRITE_EOP 0x47
|
||||||
|
#define PACKET3_EVENT_WRITE_EOS 0x48
|
||||||
|
#define PACKET3_PREAMBLE_CNTL 0x4A
|
||||||
|
#define PACKET3_RB_OFFSET 0x4B
|
||||||
|
#define PACKET3_ALU_PS_CONST_BUFFER_COPY 0x4C
|
||||||
|
#define PACKET3_ALU_VS_CONST_BUFFER_COPY 0x4D
|
||||||
|
#define PACKET3_ALU_PS_CONST_UPDATE 0x4E
|
||||||
|
#define PACKET3_ALU_VS_CONST_UPDATE 0x4F
|
||||||
|
#define PACKET3_ONE_REG_WRITE 0x57
|
||||||
|
#define PACKET3_SET_CONFIG_REG 0x68
|
||||||
|
#define PACKET3_SET_CONFIG_REG_START 0x00008000
|
||||||
|
#define PACKET3_SET_CONFIG_REG_END 0x0000ac00
|
||||||
|
#define PACKET3_SET_CONTEXT_REG 0x69
|
||||||
|
#define PACKET3_SET_CONTEXT_REG_START 0x00028000
|
||||||
|
#define PACKET3_SET_CONTEXT_REG_END 0x00029000
|
||||||
|
#define PACKET3_SET_ALU_CONST 0x6A
|
||||||
|
/* alu const buffers only; no reg file */
|
||||||
|
#define PACKET3_SET_BOOL_CONST 0x6B
|
||||||
|
#define PACKET3_SET_BOOL_CONST_START 0x0003a500
|
||||||
|
#define PACKET3_SET_BOOL_CONST_END 0x0003a518
|
||||||
|
#define PACKET3_SET_LOOP_CONST 0x6C
|
||||||
|
#define PACKET3_SET_LOOP_CONST_START 0x0003a200
|
||||||
|
#define PACKET3_SET_LOOP_CONST_END 0x0003a500
|
||||||
|
#define PACKET3_SET_RESOURCE 0x6D
|
||||||
|
#define PACKET3_SET_RESOURCE_START 0x00030000
|
||||||
|
#define PACKET3_SET_RESOURCE_END 0x00038000
|
||||||
|
#define PACKET3_SET_SAMPLER 0x6E
|
||||||
|
#define PACKET3_SET_SAMPLER_START 0x0003c000
|
||||||
|
#define PACKET3_SET_SAMPLER_END 0x0003c600
|
||||||
|
#define PACKET3_SET_CTL_CONST 0x6F
|
||||||
|
#define PACKET3_SET_CTL_CONST_START 0x0003cff0
|
||||||
|
#define PACKET3_SET_CTL_CONST_END 0x0003ff0c
|
||||||
|
#define PACKET3_SET_RESOURCE_OFFSET 0x70
|
||||||
|
#define PACKET3_SET_ALU_CONST_VS 0x71
|
||||||
|
#define PACKET3_SET_ALU_CONST_DI 0x72
|
||||||
|
#define PACKET3_SET_CONTEXT_REG_INDIRECT 0x73
|
||||||
|
#define PACKET3_SET_RESOURCE_INDIRECT 0x74
|
||||||
|
#define PACKET3_SET_APPEND_CNT 0x75
|
||||||
|
|
||||||
|
#define SQ_RESOURCE_CONSTANT_WORD7_0 0x3001c
|
||||||
|
#define S__SQ_CONSTANT_TYPE(x) (((x) & 3) << 30)
|
||||||
|
#define G__SQ_CONSTANT_TYPE(x) (((x) >> 30) & 3)
|
||||||
|
#define SQ_TEX_VTX_INVALID_TEXTURE 0x0
|
||||||
|
#define SQ_TEX_VTX_INVALID_BUFFER 0x1
|
||||||
|
#define SQ_TEX_VTX_VALID_TEXTURE 0x2
|
||||||
|
#define SQ_TEX_VTX_VALID_BUFFER 0x3
|
||||||
|
|
||||||
|
#define SQ_CONST_MEM_BASE 0x8df8
|
||||||
|
|
||||||
|
#define SQ_ESGS_RING_SIZE 0x8c44
|
||||||
|
#define SQ_GSVS_RING_SIZE 0x8c4c
|
||||||
|
#define SQ_ESTMP_RING_SIZE 0x8c54
|
||||||
|
#define SQ_GSTMP_RING_SIZE 0x8c5c
|
||||||
|
#define SQ_VSTMP_RING_SIZE 0x8c64
|
||||||
|
#define SQ_PSTMP_RING_SIZE 0x8c6c
|
||||||
|
#define SQ_LSTMP_RING_SIZE 0x8e14
|
||||||
|
#define SQ_HSTMP_RING_SIZE 0x8e1c
|
||||||
|
#define VGT_TF_RING_SIZE 0x8988
|
||||||
|
|
||||||
|
#define SQ_ESGS_RING_ITEMSIZE 0x28900
|
||||||
|
#define SQ_GSVS_RING_ITEMSIZE 0x28904
|
||||||
|
#define SQ_ESTMP_RING_ITEMSIZE 0x28908
|
||||||
|
#define SQ_GSTMP_RING_ITEMSIZE 0x2890c
|
||||||
|
#define SQ_VSTMP_RING_ITEMSIZE 0x28910
|
||||||
|
#define SQ_PSTMP_RING_ITEMSIZE 0x28914
|
||||||
|
#define SQ_LSTMP_RING_ITEMSIZE 0x28830
|
||||||
|
#define SQ_HSTMP_RING_ITEMSIZE 0x28834
|
||||||
|
|
||||||
|
#define SQ_GS_VERT_ITEMSIZE 0x2891c
|
||||||
|
#define SQ_GS_VERT_ITEMSIZE_1 0x28920
|
||||||
|
#define SQ_GS_VERT_ITEMSIZE_2 0x28924
|
||||||
|
#define SQ_GS_VERT_ITEMSIZE_3 0x28928
|
||||||
|
#define SQ_GSVS_RING_OFFSET_1 0x2892c
|
||||||
|
#define SQ_GSVS_RING_OFFSET_2 0x28930
|
||||||
|
#define SQ_GSVS_RING_OFFSET_3 0x28934
|
||||||
|
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_0 0x28940
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_1 0x28944
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_2 0x28948
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_3 0x2894c
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_4 0x28950
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_5 0x28954
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_6 0x28958
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_7 0x2895c
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_8 0x28960
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_9 0x28964
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_10 0x28968
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_11 0x2896c
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_12 0x28970
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_13 0x28974
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_14 0x28978
|
||||||
|
#define SQ_ALU_CONST_CACHE_PS_15 0x2897c
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_0 0x28980
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_1 0x28984
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_2 0x28988
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_3 0x2898c
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_4 0x28990
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_5 0x28994
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_6 0x28998
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_7 0x2899c
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_8 0x289a0
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_9 0x289a4
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_10 0x289a8
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_11 0x289ac
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_12 0x289b0
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_13 0x289b4
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_14 0x289b8
|
||||||
|
#define SQ_ALU_CONST_CACHE_VS_15 0x289bc
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_0 0x289c0
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_1 0x289c4
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_2 0x289c8
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_3 0x289cc
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_4 0x289d0
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_5 0x289d4
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_6 0x289d8
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_7 0x289dc
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_8 0x289e0
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_9 0x289e4
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_10 0x289e8
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_11 0x289ec
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_12 0x289f0
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_13 0x289f4
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_14 0x289f8
|
||||||
|
#define SQ_ALU_CONST_CACHE_GS_15 0x289fc
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_0 0x28f00
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_1 0x28f04
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_2 0x28f08
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_3 0x28f0c
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_4 0x28f10
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_5 0x28f14
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_6 0x28f18
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_7 0x28f1c
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_8 0x28f20
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_9 0x28f24
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_10 0x28f28
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_11 0x28f2c
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_12 0x28f30
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_13 0x28f34
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_14 0x28f38
|
||||||
|
#define SQ_ALU_CONST_CACHE_HS_15 0x28f3c
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_0 0x28f40
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_1 0x28f44
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_2 0x28f48
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_3 0x28f4c
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_4 0x28f50
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_5 0x28f54
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_6 0x28f58
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_7 0x28f5c
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_8 0x28f60
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_9 0x28f64
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_10 0x28f68
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_11 0x28f6c
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_12 0x28f70
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_13 0x28f74
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_14 0x28f78
|
||||||
|
#define SQ_ALU_CONST_CACHE_LS_15 0x28f7c
|
||||||
|
|
||||||
|
#define DB_DEPTH_CONTROL 0x28800
|
||||||
|
#define DB_DEPTH_VIEW 0x28008
|
||||||
|
#define DB_HTILE_DATA_BASE 0x28014
|
||||||
|
#define DB_Z_INFO 0x28040
|
||||||
|
# define Z_ARRAY_MODE(x) ((x) << 4)
|
||||||
|
#define DB_STENCIL_INFO 0x28044
|
||||||
|
#define DB_Z_READ_BASE 0x28048
|
||||||
|
#define DB_STENCIL_READ_BASE 0x2804c
|
||||||
|
#define DB_Z_WRITE_BASE 0x28050
|
||||||
|
#define DB_STENCIL_WRITE_BASE 0x28054
|
||||||
|
#define DB_DEPTH_SIZE 0x28058
|
||||||
|
|
||||||
|
#define SQ_PGM_START_PS 0x28840
|
||||||
|
#define SQ_PGM_START_VS 0x2885c
|
||||||
|
#define SQ_PGM_START_GS 0x28874
|
||||||
|
#define SQ_PGM_START_ES 0x2888c
|
||||||
|
#define SQ_PGM_START_FS 0x288a4
|
||||||
|
#define SQ_PGM_START_HS 0x288b8
|
||||||
|
#define SQ_PGM_START_LS 0x288d0
|
||||||
|
|
||||||
|
#define VGT_STRMOUT_CONFIG 0x28b94
|
||||||
|
#define VGT_STRMOUT_BUFFER_CONFIG 0x28b98
|
||||||
|
|
||||||
|
#define CB_TARGET_MASK 0x28238
|
||||||
|
#define CB_SHADER_MASK 0x2823c
|
||||||
|
|
||||||
|
#define GDS_ADDR_BASE 0x28720
|
||||||
|
|
||||||
|
#define CB_IMMED0_BASE 0x28b9c
|
||||||
|
#define CB_IMMED1_BASE 0x28ba0
|
||||||
|
#define CB_IMMED2_BASE 0x28ba4
|
||||||
|
#define CB_IMMED3_BASE 0x28ba8
|
||||||
|
#define CB_IMMED4_BASE 0x28bac
|
||||||
|
#define CB_IMMED5_BASE 0x28bb0
|
||||||
|
#define CB_IMMED6_BASE 0x28bb4
|
||||||
|
#define CB_IMMED7_BASE 0x28bb8
|
||||||
|
#define CB_IMMED8_BASE 0x28bbc
|
||||||
|
#define CB_IMMED9_BASE 0x28bc0
|
||||||
|
#define CB_IMMED10_BASE 0x28bc4
|
||||||
|
#define CB_IMMED11_BASE 0x28bc8
|
||||||
|
|
||||||
|
/* all 12 CB blocks have these regs */
|
||||||
|
#define CB_COLOR0_BASE 0x28c60
|
||||||
|
#define CB_COLOR0_PITCH 0x28c64
|
||||||
|
#define CB_COLOR0_SLICE 0x28c68
|
||||||
|
#define CB_COLOR0_VIEW 0x28c6c
|
||||||
|
#define CB_COLOR0_INFO 0x28c70
|
||||||
|
# define CB_ARRAY_MODE(x) ((x) << 8)
|
||||||
|
# define ARRAY_LINEAR_GENERAL 0
|
||||||
|
# define ARRAY_LINEAR_ALIGNED 1
|
||||||
|
# define ARRAY_1D_TILED_THIN1 2
|
||||||
|
# define ARRAY_2D_TILED_THIN1 4
|
||||||
|
#define CB_COLOR0_ATTRIB 0x28c74
|
||||||
|
#define CB_COLOR0_DIM 0x28c78
|
||||||
|
/* only CB0-7 blocks have these regs */
|
||||||
|
#define CB_COLOR0_CMASK 0x28c7c
|
||||||
|
#define CB_COLOR0_CMASK_SLICE 0x28c80
|
||||||
|
#define CB_COLOR0_FMASK 0x28c84
|
||||||
|
#define CB_COLOR0_FMASK_SLICE 0x28c88
|
||||||
|
#define CB_COLOR0_CLEAR_WORD0 0x28c8c
|
||||||
|
#define CB_COLOR0_CLEAR_WORD1 0x28c90
|
||||||
|
#define CB_COLOR0_CLEAR_WORD2 0x28c94
|
||||||
|
#define CB_COLOR0_CLEAR_WORD3 0x28c98
|
||||||
|
|
||||||
|
#define CB_COLOR1_BASE 0x28c9c
|
||||||
|
#define CB_COLOR2_BASE 0x28cd8
|
||||||
|
#define CB_COLOR3_BASE 0x28d14
|
||||||
|
#define CB_COLOR4_BASE 0x28d50
|
||||||
|
#define CB_COLOR5_BASE 0x28d8c
|
||||||
|
#define CB_COLOR6_BASE 0x28dc8
|
||||||
|
#define CB_COLOR7_BASE 0x28e04
|
||||||
|
#define CB_COLOR8_BASE 0x28e40
|
||||||
|
#define CB_COLOR9_BASE 0x28e5c
|
||||||
|
#define CB_COLOR10_BASE 0x28e78
|
||||||
|
#define CB_COLOR11_BASE 0x28e94
|
||||||
|
|
||||||
|
#define CB_COLOR1_PITCH 0x28ca0
|
||||||
|
#define CB_COLOR2_PITCH 0x28cdc
|
||||||
|
#define CB_COLOR3_PITCH 0x28d18
|
||||||
|
#define CB_COLOR4_PITCH 0x28d54
|
||||||
|
#define CB_COLOR5_PITCH 0x28d90
|
||||||
|
#define CB_COLOR6_PITCH 0x28dcc
|
||||||
|
#define CB_COLOR7_PITCH 0x28e08
|
||||||
|
#define CB_COLOR8_PITCH 0x28e44
|
||||||
|
#define CB_COLOR9_PITCH 0x28e60
|
||||||
|
#define CB_COLOR10_PITCH 0x28e7c
|
||||||
|
#define CB_COLOR11_PITCH 0x28e98
|
||||||
|
|
||||||
|
#define CB_COLOR1_SLICE 0x28ca4
|
||||||
|
#define CB_COLOR2_SLICE 0x28ce0
|
||||||
|
#define CB_COLOR3_SLICE 0x28d1c
|
||||||
|
#define CB_COLOR4_SLICE 0x28d58
|
||||||
|
#define CB_COLOR5_SLICE 0x28d94
|
||||||
|
#define CB_COLOR6_SLICE 0x28dd0
|
||||||
|
#define CB_COLOR7_SLICE 0x28e0c
|
||||||
|
#define CB_COLOR8_SLICE 0x28e48
|
||||||
|
#define CB_COLOR9_SLICE 0x28e64
|
||||||
|
#define CB_COLOR10_SLICE 0x28e80
|
||||||
|
#define CB_COLOR11_SLICE 0x28e9c
|
||||||
|
|
||||||
|
#define CB_COLOR1_VIEW 0x28ca8
|
||||||
|
#define CB_COLOR2_VIEW 0x28ce4
|
||||||
|
#define CB_COLOR3_VIEW 0x28d20
|
||||||
|
#define CB_COLOR4_VIEW 0x28d5c
|
||||||
|
#define CB_COLOR5_VIEW 0x28d98
|
||||||
|
#define CB_COLOR6_VIEW 0x28dd4
|
||||||
|
#define CB_COLOR7_VIEW 0x28e10
|
||||||
|
#define CB_COLOR8_VIEW 0x28e4c
|
||||||
|
#define CB_COLOR9_VIEW 0x28e68
|
||||||
|
#define CB_COLOR10_VIEW 0x28e84
|
||||||
|
#define CB_COLOR11_VIEW 0x28ea0
|
||||||
|
|
||||||
|
#define CB_COLOR1_INFO 0x28cac
|
||||||
|
#define CB_COLOR2_INFO 0x28ce8
|
||||||
|
#define CB_COLOR3_INFO 0x28d24
|
||||||
|
#define CB_COLOR4_INFO 0x28d60
|
||||||
|
#define CB_COLOR5_INFO 0x28d9c
|
||||||
|
#define CB_COLOR6_INFO 0x28dd8
|
||||||
|
#define CB_COLOR7_INFO 0x28e14
|
||||||
|
#define CB_COLOR8_INFO 0x28e50
|
||||||
|
#define CB_COLOR9_INFO 0x28e6c
|
||||||
|
#define CB_COLOR10_INFO 0x28e88
|
||||||
|
#define CB_COLOR11_INFO 0x28ea4
|
||||||
|
|
||||||
|
#define CB_COLOR1_ATTRIB 0x28cb0
|
||||||
|
#define CB_COLOR2_ATTRIB 0x28cec
|
||||||
|
#define CB_COLOR3_ATTRIB 0x28d28
|
||||||
|
#define CB_COLOR4_ATTRIB 0x28d64
|
||||||
|
#define CB_COLOR5_ATTRIB 0x28da0
|
||||||
|
#define CB_COLOR6_ATTRIB 0x28ddc
|
||||||
|
#define CB_COLOR7_ATTRIB 0x28e18
|
||||||
|
#define CB_COLOR8_ATTRIB 0x28e54
|
||||||
|
#define CB_COLOR9_ATTRIB 0x28e70
|
||||||
|
#define CB_COLOR10_ATTRIB 0x28e8c
|
||||||
|
#define CB_COLOR11_ATTRIB 0x28ea8
|
||||||
|
|
||||||
|
#define CB_COLOR1_DIM 0x28cb4
|
||||||
|
#define CB_COLOR2_DIM 0x28cf0
|
||||||
|
#define CB_COLOR3_DIM 0x28d2c
|
||||||
|
#define CB_COLOR4_DIM 0x28d68
|
||||||
|
#define CB_COLOR5_DIM 0x28da4
|
||||||
|
#define CB_COLOR6_DIM 0x28de0
|
||||||
|
#define CB_COLOR7_DIM 0x28e1c
|
||||||
|
#define CB_COLOR8_DIM 0x28e58
|
||||||
|
#define CB_COLOR9_DIM 0x28e74
|
||||||
|
#define CB_COLOR10_DIM 0x28e90
|
||||||
|
#define CB_COLOR11_DIM 0x28eac
|
||||||
|
|
||||||
|
#define CB_COLOR1_CMASK 0x28cb8
|
||||||
|
#define CB_COLOR2_CMASK 0x28cf4
|
||||||
|
#define CB_COLOR3_CMASK 0x28d30
|
||||||
|
#define CB_COLOR4_CMASK 0x28d6c
|
||||||
|
#define CB_COLOR5_CMASK 0x28da8
|
||||||
|
#define CB_COLOR6_CMASK 0x28de4
|
||||||
|
#define CB_COLOR7_CMASK 0x28e20
|
||||||
|
|
||||||
|
#define CB_COLOR1_CMASK_SLICE 0x28cbc
|
||||||
|
#define CB_COLOR2_CMASK_SLICE 0x28cf8
|
||||||
|
#define CB_COLOR3_CMASK_SLICE 0x28d34
|
||||||
|
#define CB_COLOR4_CMASK_SLICE 0x28d70
|
||||||
|
#define CB_COLOR5_CMASK_SLICE 0x28dac
|
||||||
|
#define CB_COLOR6_CMASK_SLICE 0x28de8
|
||||||
|
#define CB_COLOR7_CMASK_SLICE 0x28e24
|
||||||
|
|
||||||
|
#define CB_COLOR1_FMASK 0x28cc0
|
||||||
|
#define CB_COLOR2_FMASK 0x28cfc
|
||||||
|
#define CB_COLOR3_FMASK 0x28d38
|
||||||
|
#define CB_COLOR4_FMASK 0x28d74
|
||||||
|
#define CB_COLOR5_FMASK 0x28db0
|
||||||
|
#define CB_COLOR6_FMASK 0x28dec
|
||||||
|
#define CB_COLOR7_FMASK 0x28e28
|
||||||
|
|
||||||
|
#define CB_COLOR1_FMASK_SLICE 0x28cc4
|
||||||
|
#define CB_COLOR2_FMASK_SLICE 0x28d00
|
||||||
|
#define CB_COLOR3_FMASK_SLICE 0x28d3c
|
||||||
|
#define CB_COLOR4_FMASK_SLICE 0x28d78
|
||||||
|
#define CB_COLOR5_FMASK_SLICE 0x28db4
|
||||||
|
#define CB_COLOR6_FMASK_SLICE 0x28df0
|
||||||
|
#define CB_COLOR7_FMASK_SLICE 0x28e2c
|
||||||
|
|
||||||
|
#define CB_COLOR1_CLEAR_WORD0 0x28cc8
|
||||||
|
#define CB_COLOR2_CLEAR_WORD0 0x28d04
|
||||||
|
#define CB_COLOR3_CLEAR_WORD0 0x28d40
|
||||||
|
#define CB_COLOR4_CLEAR_WORD0 0x28d7c
|
||||||
|
#define CB_COLOR5_CLEAR_WORD0 0x28db8
|
||||||
|
#define CB_COLOR6_CLEAR_WORD0 0x28df4
|
||||||
|
#define CB_COLOR7_CLEAR_WORD0 0x28e30
|
||||||
|
|
||||||
|
#define CB_COLOR1_CLEAR_WORD1 0x28ccc
|
||||||
|
#define CB_COLOR2_CLEAR_WORD1 0x28d08
|
||||||
|
#define CB_COLOR3_CLEAR_WORD1 0x28d44
|
||||||
|
#define CB_COLOR4_CLEAR_WORD1 0x28d80
|
||||||
|
#define CB_COLOR5_CLEAR_WORD1 0x28dbc
|
||||||
|
#define CB_COLOR6_CLEAR_WORD1 0x28df8
|
||||||
|
#define CB_COLOR7_CLEAR_WORD1 0x28e34
|
||||||
|
|
||||||
|
#define CB_COLOR1_CLEAR_WORD2 0x28cd0
|
||||||
|
#define CB_COLOR2_CLEAR_WORD2 0x28d0c
|
||||||
|
#define CB_COLOR3_CLEAR_WORD2 0x28d48
|
||||||
|
#define CB_COLOR4_CLEAR_WORD2 0x28d84
|
||||||
|
#define CB_COLOR5_CLEAR_WORD2 0x28dc0
|
||||||
|
#define CB_COLOR6_CLEAR_WORD2 0x28dfc
|
||||||
|
#define CB_COLOR7_CLEAR_WORD2 0x28e38
|
||||||
|
|
||||||
|
#define CB_COLOR1_CLEAR_WORD3 0x28cd4
|
||||||
|
#define CB_COLOR2_CLEAR_WORD3 0x28d10
|
||||||
|
#define CB_COLOR3_CLEAR_WORD3 0x28d4c
|
||||||
|
#define CB_COLOR4_CLEAR_WORD3 0x28d88
|
||||||
|
#define CB_COLOR5_CLEAR_WORD3 0x28dc4
|
||||||
|
#define CB_COLOR6_CLEAR_WORD3 0x28e00
|
||||||
|
#define CB_COLOR7_CLEAR_WORD3 0x28e3c
|
||||||
|
|
||||||
|
#define SQ_TEX_RESOURCE_WORD0_0 0x30000
|
||||||
|
#define SQ_TEX_RESOURCE_WORD1_0 0x30004
|
||||||
|
# define TEX_ARRAY_MODE(x) ((x) << 28)
|
||||||
|
#define SQ_TEX_RESOURCE_WORD2_0 0x30008
|
||||||
|
#define SQ_TEX_RESOURCE_WORD3_0 0x3000C
|
||||||
|
#define SQ_TEX_RESOURCE_WORD4_0 0x30010
|
||||||
|
#define SQ_TEX_RESOURCE_WORD5_0 0x30014
|
||||||
|
#define SQ_TEX_RESOURCE_WORD6_0 0x30018
|
||||||
|
#define SQ_TEX_RESOURCE_WORD7_0 0x3001c
|
||||||
|
|
||||||
|
|
||||||
#endif
|
#endif
|
||||||
|
|||||||
@ -724,8 +724,8 @@ static struct radeon_asic evergreen_asic = {
|
|||||||
.irq_set = &evergreen_irq_set,
|
.irq_set = &evergreen_irq_set,
|
||||||
.irq_process = &evergreen_irq_process,
|
.irq_process = &evergreen_irq_process,
|
||||||
.get_vblank_counter = &evergreen_get_vblank_counter,
|
.get_vblank_counter = &evergreen_get_vblank_counter,
|
||||||
.fence_ring_emit = NULL,
|
.fence_ring_emit = &r600_fence_ring_emit,
|
||||||
.cs_parse = NULL,
|
.cs_parse = &evergreen_cs_parse,
|
||||||
.copy_blit = NULL,
|
.copy_blit = NULL,
|
||||||
.copy_dma = NULL,
|
.copy_dma = NULL,
|
||||||
.copy = NULL,
|
.copy = NULL,
|
||||||
|
|||||||
@ -314,6 +314,7 @@ void evergreen_hpd_set_polarity(struct radeon_device *rdev,
|
|||||||
u32 evergreen_get_vblank_counter(struct radeon_device *rdev, int crtc);
|
u32 evergreen_get_vblank_counter(struct radeon_device *rdev, int crtc);
|
||||||
int evergreen_irq_set(struct radeon_device *rdev);
|
int evergreen_irq_set(struct radeon_device *rdev);
|
||||||
int evergreen_irq_process(struct radeon_device *rdev);
|
int evergreen_irq_process(struct radeon_device *rdev);
|
||||||
|
extern int evergreen_cs_parse(struct radeon_cs_parser *p);
|
||||||
extern void evergreen_pm_misc(struct radeon_device *rdev);
|
extern void evergreen_pm_misc(struct radeon_device *rdev);
|
||||||
extern void evergreen_pm_prepare(struct radeon_device *rdev);
|
extern void evergreen_pm_prepare(struct radeon_device *rdev);
|
||||||
extern void evergreen_pm_finish(struct radeon_device *rdev);
|
extern void evergreen_pm_finish(struct radeon_device *rdev);
|
||||||
|
|||||||
611
drivers/gpu/drm/radeon/reg_srcs/evergreen
Normal file
611
drivers/gpu/drm/radeon/reg_srcs/evergreen
Normal file
@ -0,0 +1,611 @@
|
|||||||
|
evergreen 0x9400
|
||||||
|
0x00008040 WAIT_UNTIL
|
||||||
|
0x00008044 WAIT_UNTIL_POLL_CNTL
|
||||||
|
0x00008048 WAIT_UNTIL_POLL_MASK
|
||||||
|
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|
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|
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|
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|
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|
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|
||||||
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||||
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|
||||||
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0x000286F4 SPI_COMPUTE_NUM_THREAD_Z
|
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|
||||||
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|
||||||
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0x0002878C CB_BLEND3_CONTROL
|
||||||
|
0x00028790 CB_BLEND4_CONTROL
|
||||||
|
0x00028794 CB_BLEND5_CONTROL
|
||||||
|
0x00028798 CB_BLEND6_CONTROL
|
||||||
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0x0002879C CB_BLEND7_CONTROL
|
||||||
|
0x000287CC CS_COPY_STATE
|
||||||
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0x000287D0 GFX_COPY_STATE
|
||||||
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0x000287D4 PA_CL_POINT_X_RAD
|
||||||
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0x000287D8 PA_CL_POINT_Y_RAD
|
||||||
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0x000287DC PA_CL_POINT_SIZE
|
||||||
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|
||||||
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|
||||||
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0x0002880C DB_SHADER_CONTROL
|
||||||
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|
||||||
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|
||||||
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0x00028818 PA_CL_VTE_CNTL
|
||||||
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0x0002881C PA_CL_VS_OUT_CNTL
|
||||||
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0x00028820 PA_CL_NANINF_CNTL
|
||||||
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0x00028824 PA_SU_LINE_STIPPLE_CNTL
|
||||||
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0x00028828 PA_SU_LINE_STIPPLE_SCALE
|
||||||
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0x0002882C PA_SU_PRIM_FILTER_CNTL
|
||||||
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0x00028838 SQ_DYN_GPR_RESOURCE_LIMIT_1
|
||||||
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|
||||||
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|
||||||
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|
||||||
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|
||||||
|
0x00028860 SQ_PGM_RESOURCES_2_VS
|
||||||
|
0x00028878 SQ_PGM_RESOURCES_GS
|
||||||
|
0x0002887C SQ_PGM_RESOURCES_2_GS
|
||||||
|
0x00028890 SQ_PGM_RESOURCES_ES
|
||||||
|
0x00028894 SQ_PGM_RESOURCES_2_ES
|
||||||
|
0x000288A8 SQ_PGM_RESOURCES_FS
|
||||||
|
0x000288BC SQ_PGM_RESOURCES_HS
|
||||||
|
0x000288C0 SQ_PGM_RESOURCES_2_HS
|
||||||
|
0x000288D0 SQ_PGM_RESOURCES_LS
|
||||||
|
0x000288D4 SQ_PGM_RESOURCES_2_LS
|
||||||
|
0x000288E8 SQ_LDS_ALLOC
|
||||||
|
0x000288EC SQ_LDS_ALLOC_PS
|
||||||
|
0x000288F0 SQ_VTX_SEMANTIC_CLEAR
|
||||||
|
0x00028A00 PA_SU_POINT_SIZE
|
||||||
|
0x00028A04 PA_SU_POINT_MINMAX
|
||||||
|
0x00028A08 PA_SU_LINE_CNTL
|
||||||
|
0x00028A0C PA_SC_LINE_STIPPLE
|
||||||
|
0x00028A10 VGT_OUTPUT_PATH_CNTL
|
||||||
|
0x00028A14 VGT_HOS_CNTL
|
||||||
|
0x00028A18 VGT_HOS_MAX_TESS_LEVEL
|
||||||
|
0x00028A1C VGT_HOS_MIN_TESS_LEVEL
|
||||||
|
0x00028A20 VGT_HOS_REUSE_DEPTH
|
||||||
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0x00028A24 VGT_GROUP_PRIM_TYPE
|
||||||
|
0x00028A28 VGT_GROUP_FIRST_DECR
|
||||||
|
0x00028A2C VGT_GROUP_DECR
|
||||||
|
0x00028A30 VGT_GROUP_VECT_0_CNTL
|
||||||
|
0x00028A34 VGT_GROUP_VECT_1_CNTL
|
||||||
|
0x00028A38 VGT_GROUP_VECT_0_FMT_CNTL
|
||||||
|
0x00028A3C VGT_GROUP_VECT_1_FMT_CNTL
|
||||||
|
0x00028A40 VGT_GS_MODE
|
||||||
|
0x00028A48 PA_SC_MODE_CNTL_0
|
||||||
|
0x00028A4C PA_SC_MODE_CNTL_1
|
||||||
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0x00028F90 SQ_ALU_CONST_BUFFER_SIZE_HS_4
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0x00028F94 SQ_ALU_CONST_BUFFER_SIZE_HS_5
|
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0x00028F98 SQ_ALU_CONST_BUFFER_SIZE_HS_6
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0x00028F9C SQ_ALU_CONST_BUFFER_SIZE_HS_7
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0x00028FA0 SQ_ALU_CONST_BUFFER_SIZE_HS_8
|
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0x00028FA4 SQ_ALU_CONST_BUFFER_SIZE_HS_9
|
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0x00028FA8 SQ_ALU_CONST_BUFFER_SIZE_HS_10
|
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0x00028FAC SQ_ALU_CONST_BUFFER_SIZE_HS_11
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0x00028FB0 SQ_ALU_CONST_BUFFER_SIZE_HS_12
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0x00028FB4 SQ_ALU_CONST_BUFFER_SIZE_HS_13
|
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0x00028FB8 SQ_ALU_CONST_BUFFER_SIZE_HS_14
|
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0x00028FC4 SQ_ALU_CONST_BUFFER_SIZE_LS_1
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0x00028FC8 SQ_ALU_CONST_BUFFER_SIZE_LS_2
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0x00028FD0 SQ_ALU_CONST_BUFFER_SIZE_LS_4
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0x00028FD4 SQ_ALU_CONST_BUFFER_SIZE_LS_5
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0x00028FD8 SQ_ALU_CONST_BUFFER_SIZE_LS_6
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||||||
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|
||||||
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0x00028FFC SQ_ALU_CONST_BUFFER_SIZE_LS_15
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|
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|
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0x0003FF08 SQ_LOOP_BOOL_CLEAR
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