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target-mips: optimize gen_cl()
Signed-off-by: Aurelien Jarno <aurelien@aurel32.net> git-svn-id: svn://svn.savannah.nongnu.org/qemu/trunk@6932 c046a42c-6fe2-441c-8c8c-71466251a162
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20e1fb525a
@ -2128,42 +2128,36 @@ static void gen_cl (DisasContext *ctx, uint32_t opc,
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||||
int rd, int rs)
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||||
{
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||||
const char *opn = "CLx";
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||||
TCGv t0 = tcg_temp_local_new();
|
||||
TCGv t0;
|
||||
|
||||
if (rd == 0) {
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||||
/* Treat as NOP. */
|
||||
MIPS_DEBUG("NOP");
|
||||
goto out;
|
||||
return;
|
||||
}
|
||||
t0 = tcg_temp_new();
|
||||
gen_load_gpr(t0, rs);
|
||||
switch (opc) {
|
||||
case OPC_CLO:
|
||||
gen_helper_clo(t0, t0);
|
||||
gen_helper_clo(cpu_gpr[rd], t0);
|
||||
opn = "clo";
|
||||
break;
|
||||
case OPC_CLZ:
|
||||
gen_helper_clz(t0, t0);
|
||||
gen_helper_clz(cpu_gpr[rd], t0);
|
||||
opn = "clz";
|
||||
break;
|
||||
#if defined(TARGET_MIPS64)
|
||||
case OPC_DCLO:
|
||||
gen_helper_dclo(t0, t0);
|
||||
gen_helper_dclo(cpu_gpr[rd], t0);
|
||||
opn = "dclo";
|
||||
break;
|
||||
case OPC_DCLZ:
|
||||
gen_helper_dclz(t0, t0);
|
||||
gen_helper_dclz(cpu_gpr[rd], t0);
|
||||
opn = "dclz";
|
||||
break;
|
||||
#endif
|
||||
default:
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||||
MIPS_INVAL(opn);
|
||||
generate_exception(ctx, EXCP_RI);
|
||||
goto out;
|
||||
}
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||||
gen_store_gpr(t0, rd);
|
||||
MIPS_DEBUG("%s %s, %s", opn, regnames[rd], regnames[rs]);
|
||||
|
||||
out:
|
||||
tcg_temp_free(t0);
|
||||
}
|
||||
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||||
@ -7711,7 +7705,8 @@ static void decode_opc (CPUState *env, DisasContext *ctx)
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||||
case OPC_MUL:
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||||
gen_arith(env, ctx, op1, rd, rs, rt);
|
||||
break;
|
||||
case OPC_CLZ ... OPC_CLO:
|
||||
case OPC_CLO:
|
||||
case OPC_CLZ:
|
||||
check_insn(env, ctx, ISA_MIPS32);
|
||||
gen_cl(ctx, op1, rd, rs);
|
||||
break;
|
||||
@ -7728,7 +7723,8 @@ static void decode_opc (CPUState *env, DisasContext *ctx)
|
||||
/* Treat as NOP. */
|
||||
break;
|
||||
#if defined(TARGET_MIPS64)
|
||||
case OPC_DCLZ ... OPC_DCLO:
|
||||
case OPC_DCLO:
|
||||
case OPC_DCLZ:
|
||||
check_insn(env, ctx, ISA_MIPS64);
|
||||
check_mips_64(ctx);
|
||||
gen_cl(ctx, op1, rd, rs);
|
||||
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