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tcg/loongarch64: Implement sign-/zero-extension ops
Signed-off-by: WANG Xuerui <git@xen0n.name> Reviewed-by: Richard Henderson <richard.henderson@linaro.org> Reviewed-by: Philippe Mathieu-Daudé <f4bug@amsat.org> Message-Id: <20211221054105.178795-12-git@xen0n.name> Signed-off-by: Richard Henderson <richard.henderson@linaro.org>
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e3b15766b9
commit
6be08fcfc3
@ -15,3 +15,4 @@
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* tcg-target-con-str.h; the constraint combination is inclusive or.
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* tcg-target-con-str.h; the constraint combination is inclusive or.
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*/
|
*/
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C_O0_I1(r)
|
C_O0_I1(r)
|
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|
C_O1_I1(r, r)
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@ -382,6 +382,36 @@ static void tcg_out_movi(TCGContext *s, TCGType type, TCGReg rd,
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}
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}
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}
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}
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static void tcg_out_ext8u(TCGContext *s, TCGReg ret, TCGReg arg)
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{
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tcg_out_opc_andi(s, ret, arg, 0xff);
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}
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static void tcg_out_ext16u(TCGContext *s, TCGReg ret, TCGReg arg)
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{
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tcg_out_opc_bstrpick_w(s, ret, arg, 0, 15);
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|
}
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static void tcg_out_ext32u(TCGContext *s, TCGReg ret, TCGReg arg)
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{
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tcg_out_opc_bstrpick_d(s, ret, arg, 0, 31);
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|
}
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static void tcg_out_ext8s(TCGContext *s, TCGReg ret, TCGReg arg)
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{
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tcg_out_opc_sext_b(s, ret, arg);
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|
}
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static void tcg_out_ext16s(TCGContext *s, TCGReg ret, TCGReg arg)
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{
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|
tcg_out_opc_sext_h(s, ret, arg);
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|
}
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static void tcg_out_ext32s(TCGContext *s, TCGReg ret, TCGReg arg)
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{
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tcg_out_opc_addi_w(s, ret, arg, 0);
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}
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/*
|
/*
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* Entry-points
|
* Entry-points
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*/
|
*/
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@ -391,6 +421,7 @@ static void tcg_out_op(TCGContext *s, TCGOpcode opc,
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|||||||
const int const_args[TCG_MAX_OP_ARGS])
|
const int const_args[TCG_MAX_OP_ARGS])
|
||||||
{
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{
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||||||
TCGArg a0 = args[0];
|
TCGArg a0 = args[0];
|
||||||
|
TCGArg a1 = args[1];
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||||||
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switch (opc) {
|
switch (opc) {
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||||||
case INDEX_op_mb:
|
case INDEX_op_mb:
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||||||
@ -401,6 +432,41 @@ static void tcg_out_op(TCGContext *s, TCGOpcode opc,
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|||||||
tcg_out_opc_jirl(s, TCG_REG_ZERO, a0, 0);
|
tcg_out_opc_jirl(s, TCG_REG_ZERO, a0, 0);
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break;
|
break;
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||||||
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|
case INDEX_op_ext8s_i32:
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|
case INDEX_op_ext8s_i64:
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||||||
|
tcg_out_ext8s(s, a0, a1);
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|
break;
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||||||
|
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||||||
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case INDEX_op_ext8u_i32:
|
||||||
|
case INDEX_op_ext8u_i64:
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||||||
|
tcg_out_ext8u(s, a0, a1);
|
||||||
|
break;
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||||||
|
|
||||||
|
case INDEX_op_ext16s_i32:
|
||||||
|
case INDEX_op_ext16s_i64:
|
||||||
|
tcg_out_ext16s(s, a0, a1);
|
||||||
|
break;
|
||||||
|
|
||||||
|
case INDEX_op_ext16u_i32:
|
||||||
|
case INDEX_op_ext16u_i64:
|
||||||
|
tcg_out_ext16u(s, a0, a1);
|
||||||
|
break;
|
||||||
|
|
||||||
|
case INDEX_op_ext32u_i64:
|
||||||
|
case INDEX_op_extu_i32_i64:
|
||||||
|
tcg_out_ext32u(s, a0, a1);
|
||||||
|
break;
|
||||||
|
|
||||||
|
case INDEX_op_ext32s_i64:
|
||||||
|
case INDEX_op_extrl_i64_i32:
|
||||||
|
case INDEX_op_ext_i32_i64:
|
||||||
|
tcg_out_ext32s(s, a0, a1);
|
||||||
|
break;
|
||||||
|
|
||||||
|
case INDEX_op_extrh_i64_i32:
|
||||||
|
tcg_out_opc_srai_d(s, a0, a1, 32);
|
||||||
|
break;
|
||||||
|
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||||||
case INDEX_op_mov_i32: /* Always emitted via tcg_out_mov. */
|
case INDEX_op_mov_i32: /* Always emitted via tcg_out_mov. */
|
||||||
case INDEX_op_mov_i64:
|
case INDEX_op_mov_i64:
|
||||||
default:
|
default:
|
||||||
@ -414,6 +480,22 @@ static TCGConstraintSetIndex tcg_target_op_def(TCGOpcode op)
|
|||||||
case INDEX_op_goto_ptr:
|
case INDEX_op_goto_ptr:
|
||||||
return C_O0_I1(r);
|
return C_O0_I1(r);
|
||||||
|
|
||||||
|
case INDEX_op_ext8s_i32:
|
||||||
|
case INDEX_op_ext8s_i64:
|
||||||
|
case INDEX_op_ext8u_i32:
|
||||||
|
case INDEX_op_ext8u_i64:
|
||||||
|
case INDEX_op_ext16s_i32:
|
||||||
|
case INDEX_op_ext16s_i64:
|
||||||
|
case INDEX_op_ext16u_i32:
|
||||||
|
case INDEX_op_ext16u_i64:
|
||||||
|
case INDEX_op_ext32s_i64:
|
||||||
|
case INDEX_op_ext32u_i64:
|
||||||
|
case INDEX_op_extu_i32_i64:
|
||||||
|
case INDEX_op_extrl_i64_i32:
|
||||||
|
case INDEX_op_extrh_i64_i32:
|
||||||
|
case INDEX_op_ext_i32_i64:
|
||||||
|
return C_O1_I1(r, r);
|
||||||
|
|
||||||
default:
|
default:
|
||||||
g_assert_not_reached();
|
g_assert_not_reached();
|
||||||
}
|
}
|
||||||
|
@ -107,10 +107,10 @@ typedef enum {
|
|||||||
#define TCG_TARGET_HAS_muls2_i32 0
|
#define TCG_TARGET_HAS_muls2_i32 0
|
||||||
#define TCG_TARGET_HAS_muluh_i32 0
|
#define TCG_TARGET_HAS_muluh_i32 0
|
||||||
#define TCG_TARGET_HAS_mulsh_i32 0
|
#define TCG_TARGET_HAS_mulsh_i32 0
|
||||||
#define TCG_TARGET_HAS_ext8s_i32 0
|
#define TCG_TARGET_HAS_ext8s_i32 1
|
||||||
#define TCG_TARGET_HAS_ext16s_i32 0
|
#define TCG_TARGET_HAS_ext16s_i32 1
|
||||||
#define TCG_TARGET_HAS_ext8u_i32 0
|
#define TCG_TARGET_HAS_ext8u_i32 1
|
||||||
#define TCG_TARGET_HAS_ext16u_i32 0
|
#define TCG_TARGET_HAS_ext16u_i32 1
|
||||||
#define TCG_TARGET_HAS_bswap16_i32 0
|
#define TCG_TARGET_HAS_bswap16_i32 0
|
||||||
#define TCG_TARGET_HAS_bswap32_i32 0
|
#define TCG_TARGET_HAS_bswap32_i32 0
|
||||||
#define TCG_TARGET_HAS_not_i32 0
|
#define TCG_TARGET_HAS_not_i32 0
|
||||||
@ -138,14 +138,14 @@ typedef enum {
|
|||||||
#define TCG_TARGET_HAS_extract_i64 0
|
#define TCG_TARGET_HAS_extract_i64 0
|
||||||
#define TCG_TARGET_HAS_sextract_i64 0
|
#define TCG_TARGET_HAS_sextract_i64 0
|
||||||
#define TCG_TARGET_HAS_extract2_i64 0
|
#define TCG_TARGET_HAS_extract2_i64 0
|
||||||
#define TCG_TARGET_HAS_extrl_i64_i32 0
|
#define TCG_TARGET_HAS_extrl_i64_i32 1
|
||||||
#define TCG_TARGET_HAS_extrh_i64_i32 0
|
#define TCG_TARGET_HAS_extrh_i64_i32 1
|
||||||
#define TCG_TARGET_HAS_ext8s_i64 0
|
#define TCG_TARGET_HAS_ext8s_i64 1
|
||||||
#define TCG_TARGET_HAS_ext16s_i64 0
|
#define TCG_TARGET_HAS_ext16s_i64 1
|
||||||
#define TCG_TARGET_HAS_ext32s_i64 0
|
#define TCG_TARGET_HAS_ext32s_i64 1
|
||||||
#define TCG_TARGET_HAS_ext8u_i64 0
|
#define TCG_TARGET_HAS_ext8u_i64 1
|
||||||
#define TCG_TARGET_HAS_ext16u_i64 0
|
#define TCG_TARGET_HAS_ext16u_i64 1
|
||||||
#define TCG_TARGET_HAS_ext32u_i64 0
|
#define TCG_TARGET_HAS_ext32u_i64 1
|
||||||
#define TCG_TARGET_HAS_bswap16_i64 0
|
#define TCG_TARGET_HAS_bswap16_i64 0
|
||||||
#define TCG_TARGET_HAS_bswap32_i64 0
|
#define TCG_TARGET_HAS_bswap32_i64 0
|
||||||
#define TCG_TARGET_HAS_bswap64_i64 0
|
#define TCG_TARGET_HAS_bswap64_i64 0
|
||||||
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