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target/arm: Convert Saturating addition and subtraction
Reviewed-by: Philippe Mathieu-Daudé <philmd@redhat.com> Signed-off-by: Richard Henderson <richard.henderson@linaro.org> Message-id: 20190904193059.26202-9-richard.henderson@linaro.org Signed-off-by: Peter Maydell <peter.maydell@linaro.org>
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Peter Maydell
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2409d56454
commit
6d0730a824
@ -27,6 +27,7 @@
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&s_rri_rot s rn rd imm rot
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&s_rrrr s rd rn rm ra
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&rrrr rd rn rm ra
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&rrr rd rn rm
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# Data-processing (register)
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@ -122,3 +123,12 @@ UMULL .... 0000 100 . .... .... .... 1001 .... @s_rdamn
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UMLAL .... 0000 101 . .... .... .... 1001 .... @s_rdamn
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||||
SMULL .... 0000 110 . .... .... .... 1001 .... @s_rdamn
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||||
SMLAL .... 0000 111 . .... .... .... 1001 .... @s_rdamn
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# Saturating addition and subtraction
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@rndm ---- .... .... rn:4 rd:4 .... .... rm:4 &rrr
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QADD .... 0001 0000 .... .... 0000 0101 .... @rndm
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||||
QSUB .... 0001 0010 .... .... 0000 0101 .... @rndm
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||||
QDADD .... 0001 0100 .... .... 0000 0101 .... @rndm
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||||
QDSUB .... 0001 0110 .... .... 0000 0101 .... @rndm
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@ -24,6 +24,7 @@
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&s_rri_rot !extern s rn rd imm rot
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&s_rrrr !extern s rd rn rm ra
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&rrrr !extern rd rn rm ra
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&rrr !extern rd rn rm
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# Data-processing (register)
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@ -117,6 +118,7 @@ RSB_rri 1111 0.0 1110 . .... 0 ... .... ........ @s_rri_rot
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@s0_rnadm .... .... .... rn:4 ra:4 rd:4 .... rm:4 &s_rrrr s=0
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||||
@s0_rn0dm .... .... .... rn:4 .... rd:4 .... rm:4 &s_rrrr ra=0 s=0
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||||
@rnadm .... .... .... rn:4 ra:4 rd:4 .... rm:4 &rrrr
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||||
@rndm .... .... .... rn:4 .... rd:4 .... rm:4 &rrr
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{
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MUL 1111 1011 0000 .... 1111 .... 0000 .... @s0_rn0dm
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@ -128,3 +130,10 @@ UMULL 1111 1011 1010 .... .... .... 0000 .... @s0_rnadm
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||||
SMLAL 1111 1011 1100 .... .... .... 0000 .... @s0_rnadm
|
||||
UMLAL 1111 1011 1110 .... .... .... 0000 .... @s0_rnadm
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||||
UMAAL 1111 1011 1110 .... .... .... 0110 .... @rnadm
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# Data-processing (two source registers)
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QADD 1111 1010 1000 .... 1111 .... 1000 .... @rndm
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QSUB 1111 1010 1000 .... 1111 .... 1010 .... @rndm
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||||
QDADD 1111 1010 1000 .... 1111 .... 1001 .... @rndm
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||||
QDSUB 1111 1010 1000 .... 1111 .... 1011 .... @rndm
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||||
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||||
@ -8128,6 +8128,48 @@ static bool trans_UMAAL(DisasContext *s, arg_UMAAL *a)
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||||
return true;
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||||
}
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||||
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||||
/*
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||||
* Saturating addition and subtraction
|
||||
*/
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||||
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||||
static bool op_qaddsub(DisasContext *s, arg_rrr *a, bool add, bool doub)
|
||||
{
|
||||
TCGv_i32 t0, t1;
|
||||
|
||||
if (s->thumb
|
||||
? !arm_dc_feature(s, ARM_FEATURE_THUMB_DSP)
|
||||
: !ENABLE_ARCH_5TE) {
|
||||
return false;
|
||||
}
|
||||
|
||||
t0 = load_reg(s, a->rm);
|
||||
t1 = load_reg(s, a->rn);
|
||||
if (doub) {
|
||||
gen_helper_add_saturate(t1, cpu_env, t1, t1);
|
||||
}
|
||||
if (add) {
|
||||
gen_helper_add_saturate(t0, cpu_env, t0, t1);
|
||||
} else {
|
||||
gen_helper_sub_saturate(t0, cpu_env, t0, t1);
|
||||
}
|
||||
tcg_temp_free_i32(t1);
|
||||
store_reg(s, a->rd, t0);
|
||||
return true;
|
||||
}
|
||||
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||||
#define DO_QADDSUB(NAME, ADD, DOUB) \
|
||||
static bool trans_##NAME(DisasContext *s, arg_rrr *a) \
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||||
{ \
|
||||
return op_qaddsub(s, a, ADD, DOUB); \
|
||||
}
|
||||
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||||
DO_QADDSUB(QADD, true, false)
|
||||
DO_QADDSUB(QSUB, false, false)
|
||||
DO_QADDSUB(QDADD, true, true)
|
||||
DO_QADDSUB(QDSUB, false, true)
|
||||
|
||||
#undef DO_QADDSUB
|
||||
|
||||
/*
|
||||
* Legacy decoder.
|
||||
*/
|
||||
@ -8537,21 +8579,10 @@ static void disas_arm_insn(DisasContext *s, unsigned int insn)
|
||||
store_reg(s, rd, tmp);
|
||||
break;
|
||||
}
|
||||
case 0x5: /* saturating add/subtract */
|
||||
ARCH(5TE);
|
||||
rd = (insn >> 12) & 0xf;
|
||||
rn = (insn >> 16) & 0xf;
|
||||
tmp = load_reg(s, rm);
|
||||
tmp2 = load_reg(s, rn);
|
||||
if (op1 & 2)
|
||||
gen_helper_add_saturate(tmp2, cpu_env, tmp2, tmp2);
|
||||
if (op1 & 1)
|
||||
gen_helper_sub_saturate(tmp, cpu_env, tmp, tmp2);
|
||||
else
|
||||
gen_helper_add_saturate(tmp, cpu_env, tmp, tmp2);
|
||||
tcg_temp_free_i32(tmp2);
|
||||
store_reg(s, rd, tmp);
|
||||
break;
|
||||
case 0x5:
|
||||
/* Saturating addition and subtraction. */
|
||||
/* All done in decodetree. Reach here for illegal ops. */
|
||||
goto illegal_op;
|
||||
case 0x6: /* ERET */
|
||||
if (op1 != 3) {
|
||||
goto illegal_op;
|
||||
@ -10024,18 +10055,8 @@ static void disas_thumb2_insn(DisasContext *s, uint32_t insn)
|
||||
op = ((insn >> 17) & 0x38) | ((insn >> 4) & 7);
|
||||
if (op < 4) {
|
||||
/* Saturating add/subtract. */
|
||||
if (!arm_dc_feature(s, ARM_FEATURE_THUMB_DSP)) {
|
||||
goto illegal_op;
|
||||
}
|
||||
tmp = load_reg(s, rn);
|
||||
tmp2 = load_reg(s, rm);
|
||||
if (op & 1)
|
||||
gen_helper_add_saturate(tmp, cpu_env, tmp, tmp);
|
||||
if (op & 2)
|
||||
gen_helper_sub_saturate(tmp, cpu_env, tmp2, tmp);
|
||||
else
|
||||
gen_helper_add_saturate(tmp, cpu_env, tmp, tmp2);
|
||||
tcg_temp_free_i32(tmp2);
|
||||
/* All done in decodetree. Reach here for illegal ops. */
|
||||
goto illegal_op;
|
||||
} else {
|
||||
switch (op) {
|
||||
case 0x0a: /* rbit */
|
||||
|
||||
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